This subset is known as the non-synthesizable or the simulation-only subset of VHDL and can only be used for prototyping, simulation and debugging.
Το υποσύνολο αυτό είναι γνωστό σαν το μη-συντιθέμενο (non-synthesizable) υποσύνολο ή το υποσύνολο μόνο για εξομοίωση (simulation-only subset) της VHDL και μπορεί να χρησιμοποιηθεί μόνο για πρωτότυπη υλοποίηση, προσομοίωση και αποσφαλμάτωση.